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許可支持

適用於 Versal、Zynq UltraScale+ 和 Zynq 7000 SoC 以及 UltraScale+、UltraScale 和 7 係列 FPGA 的 BSDL 模型 -   BSDL Models

  • BSDL 模型文件 (ZIP - 24.49 MB)

    MD5 SUM Value : 9146290d1835888e8a205f8fbd4d6c3b

下載類型
  • BSDL Models
Last Updated
  • 2024-5-23